请教下 我装的是ISE7.1i 和 modelsim se6.2b, 为什么在进行行为仿真时双击Generate expected simulation results 后testbench波形文件不改变,做布局布线仿真时双击simulate post-place & Route VHDL model 会提示如下的错误。
请问下是为什么? 急切!!!
没破解好,可以参考一下本版面的modelsim破解的那个帖子